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Aula virtual - 86.41 / 66.17 - Sistemas Digitales
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Departamento de Electrónica
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86.41 / 66.17 Sistemas Digitales
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Presentación de la materia
Presentación VHDL
Contador de N bits Lento
Asignación de señales
Conversiones
numeric_std
Banco de pruebas
Máquinas de estado
FPGA
Multiplicación
Sigma-Delta
CORDIC
Punto Fijo - Punto Flotante
NCO (Numerically Controlled Oscillator)
UART
Picoblaze / MicroBlaze
Ejemplo de encendido de led usando PicoBlaze
PicoBlaze (KCPSM3)
Introducción a Vivado
Presentacion Aceleracion por Hardware (Video)
Diapositivas (PDF)
Presentación Curso Básico de Verilog (Video)
Diapositivas (PDF)
Codigo Fuente
Práctica 1 - VHDL
Práctica 2 - VHDL avanzado
Práctiva 3 - Circuitos Aritméticos
Práctica 4
Práctica 5
Videos de las practicas
Trabajo Práctico 1
Trabajo Práctico 2
Trabajo Práctico 2 - Archivos de prueba
Trabajo Práctico 3
Trabajos Prácticos
Dispositivos UART de las placas remotas
Trabajo práctico final (versión A)
Archivo de coordenadas
Archivo de coordenadas (copia)
Trabajo práctico final (versión B)
Trabajo práctico final (versión C)
Spartan-3 FPGA Family Data Sheet
Starter Kit Board User Guide
XST User Guide
Vivado Design Suite User Guide: Synthesis
Nexys™2 Spartan-3E FPGA Board
A survey of CORDIC algorithms for FPGA based computers
Floating point paper
Sistema con MicroBlaze (Tutorial básico)
Tutorial Vivado instalación
Tutorial Vivado licenciamiento
ISE
Vivado
ModelSim PE Student Edition - HDL Simulation
Adept
GHDL
GTKWave
VGActrl.vhd
aplicVGA.vhd
Char_ROM.vhd
VGA
VGA2
uart.vhd
uart_comps.vhd
transmit.vhd
receive.vhd
timing.vhd
serial2vga_system.vhd
board_top.vhd
Codigo
contadorN.vhd
toplevel_count.vhd
KCPSM
Sistema base - Enecender leds
Digilent Board Files (Arty Z7-10)
Aplicación para depurar la unidad de suma de Punto Flotante
Fuentes de una UART (copia)
Restricciones para la UART (copia)
Script para utilizar GHDL y GTKWave
Negador
Banco de pruebas para el negador
Sumador de 1 bit
Banco de pruebas para el sumador de 1 bit
Flip-flop D
Banco de pruebas para el Flip-flop D
Sumador de N bits
Banco de pruebas para el sumador de N bits
Sumador de N bits (version 2)
Banco de pruebas para el sumador de N bits (version 2)
Generador de habilitación
Banco de pruebas para el generador de habilitación
Código Sumador/Restador
Planilla de Simulacion del algoritmo Cordic
Planilla Sigma-Delta
Planilla Pantalla VGA
vhdl-style-guide
Paste of Code
"Computer Architecture A Quantitative Approach", Hennessy & Patterson
"VHDL: Analysis and Modeling of Digital Systems", Zainalabedin Navabi
"VHDL: Hardware description and design", Roger Lipsett, Carl Schaffer & Cary Ussery
"FPGA Prototyping by VHDL Examples: Xilinx Spartan-3 Version", Pong P. Chu
Novedades
Información util
Banco de pruebas ►
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